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      一種總線式繼電器控制板卡的設(shè)計(jì)

      2021-09-10 07:22:44李曉紅
      科技研究 2021年17期
      關(guān)鍵詞:集成化

      李曉紅

      摘要:近些年來,社會的高速發(fā)展推動著各個領(lǐng)域的高度集成化。以工業(yè)產(chǎn)業(yè)化為例,傳統(tǒng)繼電器控制柜智能化程度較淺,尤其是很多控制領(lǐng)域仍然通過傳統(tǒng)模擬電路進(jìn)行控制。該控制模式適用于一些控制回路較少等場所,在需控制回路較多等場所則無形中加大了控制板卡的電路設(shè)計(jì)難度與板卡的尺寸,提高了現(xiàn)場電源設(shè)計(jì)與走線的要求[1],這種模式并不符合集成化的設(shè)計(jì)思路。本論文提出了一種總線式的繼電器控制板卡的設(shè)計(jì),DSP通過地址與數(shù)據(jù)總線與FPGA、CPLD進(jìn)行通信,CPLD識別指令并編碼相應(yīng)控制繼電器與輸出回路進(jìn)行動作,該設(shè)計(jì)思路解決了板卡尺寸與控制集成度之間的邏輯矛盾[2],適用于現(xiàn)代集成化工業(yè)設(shè)計(jì)環(huán)境。

      關(guān)鍵詞:繼電器控制;DSP;FPGA;集成化

      中圖分類號:TN720.1 ?文獻(xiàn)標(biāo)識碼:A

      引言

      隨著社會信息高速的多元化發(fā)展,工業(yè)環(huán)境對產(chǎn)品的集成度要求越來越高。本文依托某國防科研項(xiàng)目,著重從DSP背部總線進(jìn)行分析,CPLD實(shí)現(xiàn)后端識別、解析與控制功能。對幾十路繼電器控制信號進(jìn)行分類規(guī)劃,并實(shí)現(xiàn)統(tǒng)一控制,大大降低了設(shè)計(jì)成本,提高了產(chǎn)品設(shè)計(jì)的智能化與集成化。

      1核心單元設(shè)計(jì)

      本文核心單元選取DSP與FPGA控制架構(gòu),繼電器控制板卡作為DSP整個控制流程輸出邏輯控制部分存在。DSP與FPGA通過XINTF區(qū)域總線進(jìn)行數(shù)據(jù)串并轉(zhuǎn)換,F(xiàn)PGA對數(shù)據(jù)并不進(jìn)行處理,無數(shù)據(jù)算法部分存在,轉(zhuǎn)化為并行數(shù)據(jù)后發(fā)送至背部總線,交付于底層各邏輯繼電器板卡進(jìn)行下一步識別與邏輯控制。

      DSP選擇TMS320F28335型數(shù)字信號處理器,是TI公司的一款TMS320C28X系列浮點(diǎn)DSP控制器。與以往的定點(diǎn)DSP相比,該器件的精度高,成本低,功耗小,性能高,外設(shè)集成度高,數(shù)據(jù)以及程序存儲量大,A/D轉(zhuǎn)換更精確快速等。TMS320F28335具有150MHz的高速處理能力,具備32位浮點(diǎn)處理單元,6個DMA通道支持ADC、McBSP和 EMIF,有多達(dá)18路的PWM輸出,其中有6路為TI特有的更高精度的PWM輸出 (HRPWM),12位16通道ADC。得益于其浮點(diǎn)運(yùn)算單元,用戶可快速編寫控制算法而無需在處理小數(shù)操作上耗費(fèi)過多的時間和精力,與前代DSP相比,平均性能提高50%[3],并與定點(diǎn)C28x控制器軟件兼容,從而簡化軟件開發(fā),縮短開發(fā)周期,降低開發(fā)成本。該芯片中電58所國產(chǎn)可替代。

      FPGA選擇XILINX公司生產(chǎn)的7K325TFG900,國產(chǎn)有替代。配置ROM選用深圳國微公司的SM18V04實(shí)現(xiàn)。

      FPGA具有如下特點(diǎn):

      a)集成度高,器件密度大,速度快,片上存儲器資源能夠滿足設(shè)計(jì)需求,可以實(shí)現(xiàn)極其復(fù)雜的時序與組合邏輯電路功能;

      b)最多支持32路GTX,每路GTX最高支持12.5Gbps,滿足設(shè)計(jì)要求;

      c)包含478k個Slice,每個Slice包含4個6輸入的LUT和8個FF寄存器,即總共包含303600個LUT和607200個FF寄存器,可以實(shí)現(xiàn)極其復(fù)雜的時序與組合邏輯功能;

      d)具有豐富的存儲器資源,包含8088 Kbits的分布式RAM和1030個Block RAM;

      e)包含豐富的時鐘資源,包含14個時鐘管理單元CMT,每個CMT由1個MMCM和1個PLL組成;

      f)具有豐富的IO資源,包含700個單端IO和226個差分IO對;

      2、FPGA軟件部分設(shè)計(jì)

      FPGA系統(tǒng)設(shè)計(jì)中,DSP為主機(jī),F(xiàn)PGA為從機(jī),DSP與FPGA通過DSP的XINTF數(shù)據(jù)總線進(jìn)行數(shù)據(jù)交互。XINTF數(shù)據(jù)總線包括16位地址線和16位數(shù)據(jù)線[4]。

      3 繼電器控制部分設(shè)計(jì)

      上述各繼電器板卡之間的總線控制首先需要結(jié)合DSP芯片選XINTF功能,定義相應(yīng)讀、寫、地址線、數(shù)據(jù)線、片選線,管腳分配結(jié)合原理圖引腳定義相應(yīng)輸入輸出管腳。背板總線與CPLD直接之間進(jìn)行74LS245芯片設(shè)計(jì),主要起到驅(qū)動隔離的作用,結(jié)合245芯片功能,定義CPLD上相應(yīng)DIR與OE控制線并分配相應(yīng)管腳[5]。數(shù)字量輸入板主要針對16路無源信號與3路有源信號進(jìn)行檢測,代碼中分配2個8位寄存器與一個4位寄存器,分配16位地址總線與數(shù)據(jù)總線,外部光耦設(shè)計(jì)邏輯為低電平有效[6],DSP回讀數(shù)據(jù)默認(rèn)狀態(tài)為高電平,外部信號輸入呈現(xiàn)數(shù)字量‘0’,無數(shù)據(jù)回讀時呈現(xiàn)數(shù)字量‘1’繼電器控制部分主要完成FPGA背部總線數(shù)據(jù)片選、解析與控制功能[7]。

      4 結(jié)論

      該項(xiàng)目成功驗(yàn)證了總線式繼電器板卡控制的穩(wěn)定性、多樣性與集成化等特性。通過上位機(jī)可直接控制幾十條繼電器控制回路,僅僅通過一個繼電器板卡即可完成,該模式可完全替代傳統(tǒng)繼電器控制柜中復(fù)雜的布線與控制回路,具有很好的工業(yè)推廣價(jià)值。

      參考文獻(xiàn)

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