基于ＣＰＬＤ／ＦＰＧＡ高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)
2009-06-25 04:45:56賈正松
現(xiàn)代電子技術(shù) 2009年9期
賈正松
摘要：針對(duì)傳統(tǒng)數(shù)據(jù)采集與處理系統(tǒng)存在運(yùn)算能力差，擴(kuò)展難度大等缺點(diǎn)，采用CPLD/FPGA可編程邏輯器件、ARM32位嵌入式微處理器。FIFO存儲(chǔ)器、USB接口設(shè)計(jì)多功能的高速數(shù)據(jù)采集系統(tǒng)，并設(shè)計(jì)出系統(tǒng)硬件結(jié)構(gòu)和軟件流程。該系統(tǒng)可實(shí)現(xiàn)對(duì)各種模擬信號(hào)的數(shù)據(jù)采集和處理，實(shí)用性強(qiáng)，可靠性高，編程靈活，數(shù)據(jù)采集和傳輸速度快，具有很好的應(yīng)用和發(fā)展前景。
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